Échantillonnage

Implications du taux d'échantillonnage ADC MATLAB / SIMULINK M-PSK Modulation

Implications du taux d'échantillonnage ADC MATLAB / SIMULINK M-PSK Modulation
  1. Quel est le taux d'échantillonnage d'un ADC?
  2. Comment réduire le taux d'échantillonnage ADC?
  3. Comment l'ADC augmente-t-il le taux d'échantillonnage?

Quel est le taux d'échantillonnage d'un ADC?

Le taux d'échantillonnage est la fréquence exprimée dans Hertz (Hz) à laquelle l'ADC échantillonne le signal analogique d'entrée. Comme mentionné précédemment, l'intervalle d'échantillonnage est le temps entre les échantillons successifs: le taux d'échantillonnage est donc l'inverse de l'intervalle d'échantillonnage.

Comment réduire le taux d'échantillonnage ADC?

L'augmentation du temps d'échantillonnage ralentira le taux. Le ralentissement de l'horloge ADC ralentira également le taux d'échantillonnage. Sinon, vous devez le configurer pour déclencher une minuterie et régler la minuterie sur la fréquence d'échantillonnage souhaitée. C'est l'approche commune.

Comment l'ADC augmente-t-il le taux d'échantillonnage?

Pour augmenter le taux d'échantillonnage d'un ADC dont les comparateurs fonctionnent déjà à une vitesse maximale, le nombre de blocs de quantification supérieurs (grossiers) et inférieurs (fins) doit être étendu. Cela peut être réalisé en mettant en œuvre un ADC N bits, grossier et deux ADC à interliné dans le temps, N-BIT, fine (figure 2).

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